长沮1. 项目背景与核心价值
在工业自动化、智能电网和车载网络等实时性要求极高的场景中，微秒级甚至纳秒级的时间同步已成为刚需。传统网络协议如NTP（网络时间协议）只能提供毫秒级同步精度，而IEEE 1588 Precision Time Protocol（PTP）及其衍生协议（如802.1AS）通过硬件时间戳和精密时钟补偿，将同步精度提升到亚微秒级。
这个项目的独特之处在于完全通过FPGA逻辑实现802.1AS时间同步协议栈，相比传统方案（如基于Linux的ptp4l）具有三大优势：
- 确定性延迟：硬件逻辑处理报文的时间固定，避免操作系统调度带来的抖动
- 低资源占用：无需运行完整操作系统，适合嵌入式设备
- 自定义扩展：可灵活添加时间戳点（如物理层PHY与MAC接口处）
提示：802.1AS是TSN（时间敏感网络）标准族中的时间同步协议，基于IEEE 1588-2008（PTPv2）优化，主要针对车载和工业场景的确定性传输需求。
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2. 协议栈架构设计
2.1 硬件逻辑分层
整个设计采用分层架构，自底向上分为：
code复制┌───────────────────────┐
│ 应用层接口 │ ← 提供时间戳API给上层应用
├───────────────────────┤
│ 协议引擎 │ ← 处理Sync/Follow_Up/Delay_Req/Resp报文
├───────────────────────┤
│ 时钟伺服 │ ← 实现PI控制器调整本地时钟
├───────────────────────┤
│ 硬件时间戳单元 │ ← 在MAC层打精确时间戳
├───────────────────────┤
│ 以太网MAC+PHY │ ← 物理层接口
└───────────────────────┘
2.2 关键状态机设计
协议核心是三个并行状态机：
- 主时钟状态机（Master FSM）：
verilog复制
IDLE → SEND_SYNC → WAIT_FOLLOW_UP → SEND_DELAY_RESP → IDLE