sylph mini1. D触发器基础原理与特性解析
D触发器（Data Flip-Flop）是数字电路中最基础的时序逻辑元件之一，它的核心特性可以概括为"次态等于当前输入"。具体来说，在时钟信号的有效边沿（上升沿或下降沿），触发器会将D端（数据端）的输入值捕获并保持，直到下一个有效时钟边沿到来。
1.1 基本工作原理
D触发器的真值表非常简单：
| CLK | D | Q(n+1) |
|---|---|---|
| ↑ | 0 | 0 |
| ↑ | 1 | 1 |
| 其他 | X | 保持 |
这个特性使得D触发器成为数字系统中存储1位信息的基本单元。在实际应用中，D触发器通常还包含异步复位（Reset）和置位（Set）端，允许直接强制输出为0或1，不受时钟控制。
1.2 边沿触发与电平触发的区别
边沿D触发器（如74HC74）与电平触发锁存器（如74HC75）的关键区别在于：
- 边沿触发：只在时钟上升沿或下降沿瞬间采样输入，抗干扰能力强
- 电平触发：在时钟有效电平期间都透明传输输入，容易产生"空翻"现象
提示：在FPGA设计中，通常推荐使用边沿触发触发器，因为现代FPGA的slice中已经优化了这类触发器的实现。
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2. 传输门实现D触发器的方案
2.1 传输门基础
传输门（Transmission Gate）由PMOS和NMOS晶体管并联构成，可以双向传输模拟/数字信号。其关键特性：
- 当控制端为高电平时导通，低电平时关断
- 导通电阻低（约几百欧姆）
- 能够传输完整的逻辑电平（不像单个MOS管存在阈值损失）
2.2 基于传输门的D触发器电路
一个典型的传输门D触发器由两个传输门和两个反相器构成主从结构：
code复制[图示说明]
CLK ───┬─── TG1 ─── INV1 ───┬── Q
│ │
└─── TG2 ─── INV2 ───┘
工作原理分阶段：
- CLK=1时：
- TG1导通，D端输入进入主锁存器
- TG2关断，从锁存器保持原状态
- CLK下降沿：
- TG1迅速关断，锁定主锁存器状态
- TG2短暂导通，将主锁存器状