云山雾村1. ARM11 MPCore硬件架构解析
ARM11 MPCore是多核处理器设计的经典代表，采用对称多处理(SMP)架构，最多可集成4个ARM11 CPU核心。每个核心拥有独立的L1缓存，并通过共享的L2缓存控制器(L220)实现高效数据协同。这种设计在2005-2010年间广泛应用于嵌入式系统、网络设备和移动基带处理器等领域。
1.1 核心模块组成
测试芯片的硬件架构包含以下关键组件：
- 处理器集群：4个ARM11 CPU核心，每个核心支持独立时钟门控（通过nCPURESET[3:0]信号控制）
- 缓存系统：64KB共享L2缓存（L220控制器）采用8路组相联设计，缓存行长度32字节
- 互连总线：双AXI总线接口（Port 0和Port 1），支持2:1时分复用降低引脚数量
- 时钟系统：片内PLL支持动态频率调整，核心与总线时钟比可通过CLKDIV寄存器配置
- 调试接口：完整JTAG边界扫描链，支持多核同步调试和跟踪（注：该测试芯片不支持Trace功能）
实际项目中需注意：MPCore的nTRST信号必须通过10kΩ电阻上拉，调试器连接时nTRST脉冲宽度应大于50μs才能可靠复位TAP控制器。
1.2 电源管理设计
测试芯片采用三级电压域设计，需特别注意电源时序：
plaintext复制VDDCORE (1.2V) ────┐
│→ CPU核心供电
AVDD_PLL (1.2V) ───┘
VDDIO (1.8V) ────→ 接口电平
电源监控通过12位ADC实现，计算公式：
- 核心电压：
VDDCORE = 0.8V * ((1 + R47*(R49+R83)/(R49*R83)) - (Idac*R47)) - 采样精度：LSB=610μV（基准电压2.5V/4096）
典型问题排查：
- 若PGOOD信号异常，首先检查反馈电阻网络（R47/R49/R83）
- 电流突变时ADC读数溢出？确认Rsense电阻值（VDDCORE用0.025Ω，AVDD用0.5Ω）
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2. JTAG调试系统实现
2.1 接口物理连接
CT11MPCore开发板的JTAG连接拓扑如下：
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