Nerd Muscle1. ZYNQ DMA数据传输方案概述
在嵌入式系统开发中，ZYNQ系列SoC因其独特的ARM处理器(PS)与FPGA(PL)协同架构而广受欢迎。其中，DMA（直接内存访问）技术是实现高效数据传输的关键手段。本文将深入剖析两种典型的AXI-DMA实现方案，帮助开发者根据项目需求选择最适合的路径。
我曾在一个视频处理项目中同时应用过这两种方案：模式1用于稳定的1080p视频流传输，模式2则处理突发性传感器数据包。实测数据显示，模式1的传输延迟稳定在2ms以内，而模式2虽然平均延迟略高（约3ms），但能更好地适应数据量波动达±30%的场景。
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2. 方案1：UIO+DMA双缓存模式详解
2.1 硬件架构设计
这种模式下，PL侧的AXI DMA控制器通过S2MM（Stream to Memory Map）接口直接连接PS侧。根据性能需求有两种连接方式：
-
HP（High Performance）接口：数据直达DDR，绕过CPU缓存。在需要确定性的低延迟场景（如实时图像处理）中表现优异。实测带宽可达1.2GB/s（@150MHz AXI时钟）
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ACP（Accelerator Coherency Port）接口：数据通过SCU（Snoop Control Unit）进入CPU缓存。硬件自动维护缓存一致性，特别适合需要频繁CPU访问的场景（如机器学习推理）。但要注意，ACP接口带宽通常只有HP的60-70%
硬件设计要点：在Vivado Block Design中，必须正确设置DMA控制器的数据宽度（通常32/64/128bit）以匹配FPGA侧的数据位宽。我曾因误设为32bit导致实际带宽只有预期的1/4。
2.2 软件驱动实现
驱动层采用Linux标准UIO框架，其优势在于：
c复制// 典型设备树配置
reserved-memory {
#address-cells = <1>;
#size-cells = <1>;
ranges;
dma_reserved: buffer@0x10000000 {
compatible = "shared-dma-pool";
reg = <0x10000000 0x08000000>; // 12