1. ZYNQ平台TCP高速传输实战：从PL到PC的完整设计
刚调通的热乎方案还带着开发板的余温，这次在ZYNQ上实现的TCP传输框架实测稳定跑满500Mbps，峰值突破700Mbps。不同于教科书式的理论讲解，这里直接分享从硬件设计到软件调优的全套实战经验，包含那些只有踩过坑才知道的细节。
这个方案的核心价值在于打通了PL到PC的完整数据链路：PL端产生的数据（如图像传感器采集的视频流或ADC采样数据）通过AXI DMA高效搬运到PS端的DDR3内存，再通过精心调优的LWIP协议栈经千兆以太网传输到上位机。实测可稳定传输1080P视频流（45fps）或10MSPS的ADC采样数据，适合需要高速实时数据传输的工业检测、医疗影像等场景。
2. 硬件设计：BD搭建与DMA配置陷阱
2.1 Vivado BD搭建关键步骤
在Vivado中搭建硬件平台时，AXI DMA的配置直接决定传输效率。建议按以下顺序操作：
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创建ZYNQ Processing System IP核后，首先启用HP0端口（High Performance端口），这是DMA直接访问DDR3的通道。在PS-PL Configuration -> HP Slave AXI Interface中勾选S AXI HP0接口。
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添加AXI DMA IP核时，必须勾选Scatter Gather模式。实测启用SG模式后吞吐量提升30%以上，因为SG引擎可以自动管理多个不连续的内存块传输。配置参数建议：
- Width of Buffer Length Register: 23位（支持最大8MB单次传输）
- Enable Scatter Gather: 勾选
- Number of MM2S Channels: 1
- Number of S2MM Channels: 1
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连接时特别注意数据流向：
- PL端数据通过AXI Stream接入S_AXIS_S2MM（PL→PS方向）
- PS端发送数据通过M_AXIS_MM2S连接PL（PS→PL方向）
- 常见错误是把MM2S和S2MM接反，导致数据传输方向错误（血泪教训）
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时钟配置要点：
- AXI DMA操作时钟（通常150MHz）必须与PL端数据时钟同步