神经小黑1. StarRC与PT时序分析流程概述
在芯片设计后端流程中，寄生参数提取与时序分析是确保设计满足性能指标的关键环节。StarRC作为业界标准的寄生参数提取工具，能够从物理版图中精确提取互连线的电阻（R）、电容（C）以及耦合电容（CC）等寄生参数。这些参数随后被传递到PrimeTime（PT）进行静态时序分析（STA），以验证设计是否满足建立时间（setup time）和保持时间（hold time）等时序约束。
关键提示：从StarRC到PT的数据传递需要确保文件格式和参数定义的完整性，任何中间环节的缺失都可能导致时序分析结果失真。
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2. StarRC输出文件详解
2.1 标准寄生交换格式（SPEF）
SPEF文件是StarRC输出的核心文件，采用IEEE 1481-1999标准格式，包含以下关键信息：
- 网络连接拓扑结构
- 每个节点的寄生电阻和电容值
- 耦合电容的相互影响关系
- 工艺角（corner）信息
典型SPEF文件片段示例：
code复制*D_NET NET123 1.23
*CONN
*I *123:INP O *I *456:OUT I
*CAP
1 *123:INP 0.12
2 *456:OUT 0.15
3 1 2 0.08
*RES
1 *123:INP 1 2.5
2 1 *456:OUT 3.1
*END
2.2 工艺角与PVT条件
StarRC需要为不同工艺角生成对应的SPEF文件，通常包括：
- 最差情况（Worst Case）：慢速工艺、高温度、低电压（SS/125C/0.9V）
- 典型情况（Typical Case）：典型工艺、常温、标称电压（TT/25C/1.0V）
- 最佳情况（Best Case）：快速工艺、低温、高电压（FF/-40C/1.1V）
实际项目中，工艺角定义可能更复杂，需根据Foundry提供的工艺文件（.itf或.tluplus）精确配置。
3. PT时序分析输入准备
3.1 必需输入文件清单
| 文件类型 | 说明 | 生成工具 |
|---|---|---|
| SPEF | 寄生参数网表 | StarRC |
| SDC | 设计约束 | 设计团队 |
| Verilog |