Neo-ke1. Arm GIC-700中断控制器架构解析
GIC-700作为Arm CoreLink系列中的旗舰级中断控制器，采用创新的分布式架构设计，专为现代多核异构计算平台打造。其核心架构包含三个关键层级：
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分发器层（Distributor）：作为全局中断路由中心，通过GICD_*寄存器组实现对所有共享外设中断（SPI）的使能、优先级和目标配置。在GIC-700中，分发器支持多达960个SPI，并引入跨芯片中断路由机制，允许将中断灵活路由至不同芯片上的处理器。
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重分发器层（Redistributor）：每个物理处理器核心配备独立的重分发器，通过GICR_*寄存器组管理私有外设中断（PPI）和本地特定中断（LPI）。GIC-700的重分发器新增低功耗状态机，支持处理器睡眠状态下的中断唤醒管理。
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ITS组件（Interrupt Translation Service）：负责将设备ID与事件ID转换为物理或虚拟LPI的中断转换引擎。GIC-700的ITS支持多达256个设备表项，每个设备可配置最多32位事件ID空间，为虚拟化场景提供硬件级支持。
关键设计要点：GIC-700引入的SplitEOI模式将中断确认(ACK)与结束(EOI)操作分离，可显著降低虚拟化场景下的中断延迟。该模式需要通过GICD_CTLR.EOImode位使能。
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2. 跨芯片SPI中断传递问题深度分析
2.1 错误3817150的技术背景
在多芯片互联系统中，SPI中断可能从其连接的本地芯片（local_chip）路由到远程芯片（remote_chip）上的目标处理器。当出现以下时序条件时，会触发该错误：
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中断状态机异常：SPI在remote_chip上被激活（ICC_IAR_EL1访问）后，若在未完成EOI前被召回local_chip（通过电平变化或寄存器编程），此时若中断再次pending，状态机可能进入死锁状态。
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目标处理器约束：local_chip上存在匹配GICD_IROUTERn低亲和性字段的处理器，且该处理器处于睡眠状态（GICR_WAKER.ProcessorSleep=1）或其CPU组使能关闭。
2.2 错误现象的具体表现
受影响系统会观察到以下异常现象：
- 中断延迟激增：SPI中断可能延迟数毫秒甚至更久才送