1. 柔性电子与边缘AI芯片的技术突破
清华大学任天令教授团队在Nature正刊发表的研究成果,标志着柔性电子与边缘人工智能芯片领域取得了里程碑式进展。这项研究最引人注目的创新点在于将传统刚性AI芯片的运算能力成功移植到可弯曲、可拉伸的柔性基底上,同时保持了优异的能效比和计算性能。
柔性电子器件的核心挑战在于如何在材料形变时保持稳定的电学性能。研究团队通过开发新型纳米复合材料,在拉伸率超过30%的情况下仍能保持晶体管迁移率高于200 cm²/V·s。这种材料由碳纳米管网络和弹性体基质构成,通过精确控制纳米管取向和密度,实现了导电通路在形变过程中的自修复特性。
在芯片架构方面,团队创新性地采用了存算一体设计,将模拟计算单元直接嵌入存储器阵列。这种架构在边缘AI应用中具有显著优势:首先,它消除了传统冯·诺依曼架构中的数据搬运瓶颈,使能效比提升达两个数量级;其次,模拟计算天生适合处理传感器产生的连续信号,特别适合柔性电子与物联网设备的应用场景。
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2. 关键技术实现路径解析
2.1 柔性基底材料工程
研究团队开发的多层异质结构柔性基底包含三个关键功能层:
- 动态键合层:采用含动态共价键的聚硅氧烷材料,在室温下具有自修复能力
- 应力缓冲层:多孔聚酰亚胺结构可吸收80%以上的机械应变
- 功能集成层:嵌有银纳米线的PDMS矩阵,同时实现导电性和可拉伸性
这种"三明治"结构通过有限元分析优化各层厚度比(典型值为1:3:2),在10万次弯曲循环后仍保持90%以上的初始电导率。材料制备采用卷对卷(R2R)工艺,通过控制涂布速度(0.5-2 m/min)和固化温度(80-120℃)实现大面积均匀成膜。
2.2 可拉伸晶体管阵列
晶体管的可拉伸性通过两种创新设计实现:
- 蛇形互联:采用 fractal 分形几何布局的源漏电极,在拉伸时通过几何形变而非材料应变来吸收应力
- 岛桥结构:将刚性功能单元(岛)通过可拉伸导线(桥)连接,局部应变降低至整体应变的1/5
测试数据显示,该设计在30%应变下保持开关比>10⁶,亚阈值摆幅<100 mV/dec,这些指标已接近传统刚性硅基晶体管的性能水平。
2.3 存算一体架构优化
团队开发的模拟存算单元(CIM)具有以下特征:
- 采用3D堆叠的阻变存储器(RRAM)阵列
- 每个
