Ga Ou1. ARM VFP11浮点协处理器架构解析
VFP11是ARMv6架构中重要的浮点运算加速单元，采用完全硬件化的流水线设计实现IEEE 754-1985标准。与软件模拟浮点运算相比，其典型加速比可达50-100倍。该协处理器通过独立的64位数据总线与ARM11内核交互，支持单周期发射多数算术指令。
1.1 核心架构特性
VFP11采用三级流水线设计（取指-执行-写回），与ARM11内核的8级流水线形成协同工作机制。其寄存器文件包含32个双精度寄存器（可映射为64个单精度寄存器），支持以下关键特性：
- 双发射流水线：独立的加法器与乘法器可并行执行不同类指令
- 短向量模式：支持单指令多数据（SIMD）操作，最多可同时处理4个单精度浮点数
- 硬件除法器：采用迭代算法实现单周期12-bit精度的除法运算
- 非规格化数据处理：通过RunFast模式自动刷新非规格化数为零，避免性能惩罚
注意：启用RunFast模式时，处理器会隐式将非规格化操作数视为零，这可能导致极小数值的计算结果与严格IEEE标准存在差异。在需要完全合规的金融或科学计算场景应禁用此模式。
1.2 指令集概览
VFP11指令可分为五大类，其典型延迟周期如下表所示：
| 指令类型 | 示例指令 | 延迟周期(单精度/双精度) |
|---|---|---|
| 算术运算 | FADD, FSUB | 4/5 |
| 乘积累加 | FMAC, FNMAC | 5/7 |
| 比较与转换 | FCMP, FCVT | 3/4 |
| 存储加载 | FLD, FST | 3 + 内存访问周期 |
| 特殊运算 | FSQRT, FDIV | 12-20（依赖精度需求） |
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