seiji morisako1. TMS320DM355芯片存储接口架构解析
TMS320DM355作为德州仪器(TI)推出的一款数字媒体系统级芯片(DMSoC)，其存储子系统设计体现了嵌入式处理器与外部存储器高效协同的典型架构。这款芯片主要面向数字视频处理、嵌入式视觉系统等应用场景，其存储接口的性能直接决定了整个系统的数据处理能力。
在DM355的存储架构中，两大核心接口模块承担着不同的职责：
- 异步外部存储器接口(AEMIF)：主要负责连接各类非易失性存储设备
- DDR内存接口：则专注于高速数据缓存需求
这种分工明确的架构设计使得芯片能够同时满足程序存储和大容量数据缓存的多样化需求。
从技术实现角度来看，AEMIF接口在DM355中具有高度灵活性：
- 支持8位或16位数据总线宽度
- 地址总线可扩展至14位(EM_A[13:0])
- 提供两个独立的片选信号(EM_CE0和EM_CE1)
这种设计使得单个芯片可以同时连接多个不同类型的存储设备，如NOR Flash、NAND Flash和OneNAND等。在实际应用中，工程师可以通过配置AECFG[3:0]引脚状态来设定接口的默认工作模式，这为系统启动前的硬件配置提供了便利。
DDR接口方面，DM355支持DDR2和移动DDR(mDDR)标准：
- 采用16位数据总线(DDR_DQ[15:0])
- 包含13位地址总线(DDR_A[12:0])
- 支持最高133MHz的时钟频率
这种配置能够提供足够的内存带宽，满足大多数嵌入式媒体处理应用的需求。特别值得注意的是，芯片内部集成了DLL(延迟锁定环)电路，用于精确控制DDR接口的时序，这对于保证高速数据传输的稳定性至关重要。
关键提示：在硬件设计时，DDR_VREF引脚必须通过外部电阻分压网络提供精确的参考电压，这是确保DDR接口信号完整性的关键因素。即使使用mDDR时，这个外部电路也不可省略。
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2. AEMIF接口深度剖析
2.1 接口信号组成与功能
AEMIF接口的信号架构体现了高度复用和灵活配置的设计理念。根据DM355的技术文档，我们可以将这些信号分为几个关键功能组：
地址总线部分：
- EM_A[13:0]：14位地址总线，实际可用宽度取决于具体存储设备类型
- EM_BA0和EM_BA1：银行选择信号，在不同模式下功能有所不同
- 在16位模式下，EM_BA1作为最低位地址
- 在8位模式下，EM_BA0作为最低位地址
数据总线部分：
- EM_D[15:0]：16位双向数据总线
- 通过配置可工作于8位或16位模式
控制信号部分：
- EM_CE0/CE1：片选信号，低电平有效
- EM_OE：输出使能，控制数据读取
- EM_WE：写使能，控制数据写入
- EM_WAIT：异步等待信号，用于插入等待状态
特殊功能信号：
- EM_CLK：OneNAND接口时钟
- EM_ADV：OneNAND地址有效指示
这种信号设计的一个显著特点是大多数引脚都具有多功能复用能力。例如，EM_A13引脚同时作为GIO067和BTSEL[1]功能，这种设计在有限的引脚资源下实现了最大的功能灵活性。
2.2 工作模式与配置机制
AEMIF接口支持三种主要工作模式，每种模式都有其特定的应用场景和配置要求：
- 异步存储器模式：
- 典型应用：连接NOR Flash或SRAM
- 关键配置参数：
- 建立时间(Setup Time)
- 保持时间(Hold Time)
- 等待时间