低温漂带隙基准电压源设计与高阶温度补偿技术

温绚

1. 项目概述:低温漂带隙基准电压源设计挑战

在精密模拟电路设计中,基准电压源如同航海中的罗盘,其稳定性直接决定整个系统的测量精度。传统带隙基准电压源虽然能提供相对稳定的参考电压,但在极端温度环境或高精度应用场景下,其温度漂移特性往往成为系统误差的主要来源。我最近完成的一个设计项目实现了1.9V输出电压条件下仅1.9ppm/°C的超低温漂特性,这个指标已经接近目前工业界可实现的极限水平。

这个设计的核心突破在于采用了创新的高阶温度补偿技术。与常规的一阶补偿方案不同,我们通过建立精确的温度特性数学模型,在电路结构中引入了对温度二次项甚至更高阶项的补偿机制。实测数据显示,在-40°C至125°C的军工级温度范围内,输出电压变化不超过±0.5mV,相当于将传统设计的温度漂移降低了近一个数量级。

2. 带隙基准基础原理深度解析

2.1 传统带隙基准的工作机制

带隙基准电压源的核心思想可以形象地理解为"电压拼图"——将两个具有相反温度系数的电压分量以适当比例相加,从而在理论上实现零温度系数。具体实现上,通常利用双极型晶体管(BJT)的基极-发射极电压VBE(负温度系数)与热电压VT(正温度系数)进行组合。

在实际电路实现中,最经典的Brokaw带隙核心结构采用运算放大器强制两个支路电流相等,通过电阻网络调整VT的放大倍数。理想情况下,当输出电压满足VREF = VBE + K·VT时,通过选择合适的K值可以使两项的温度系数相互抵消。然而,这种一阶补偿存在两个固有缺陷:VBE本身具有非线性温度特性,以及电阻的温度系数未被纳入补偿范围。

2.2 温度漂移的本质原因

通过深入分析半导体物理特性,我们发现传统设计的局限主要来自三个方面:首先,VBE的温度特性实际上遵循更为复杂的表达式:

code复制VBE(T) = VG0(1-T/T0) + VBE0(T/T0) + (η-1)(kT/q)ln(T0/T)

其中VG0是外推至绝对零度的带隙电压,η是与工艺相关的常数。这个方程中的对数项就是传统一阶补偿无法消除的非线性分量。

其次,电阻的温度系数(通常为几百ppm/°C)会直接影响K值的温度稳定性。在我们的测试中,普通多晶硅电阻的温度系数会导致约10ppm/°C的额外漂移。

最后,运算放大器的失调电压及其温度漂移也会通过反馈环路影响最终输出。特别是在低功耗设计中,放大器的增益有限,这个影响更为显著。

3. 高阶温度补偿技术实现方案

3.1 补偿架构设计思路

我们的高阶补偿方案采用了"分段拟合"的策略,将整个工作温度范围划分为多个区间,在每个区间采用不同的补偿参数。具体实现上,在传统Brokaw核心结构基础上增加了三个关键模块:

  1. 温度传感与区间选择电路:利用多个BJT串联结构产生与绝对温度相关的阶梯电压,通过比较器网络判断当前所处的温度区间

  2. 可调电流比例网络:采用R-2R梯形电阻网络配合开关阵列,根据温度区间动态调整VT项的放大系数K

  3. 非线性校正模块:在运放反馈路径中插入由温度控制的跨导电路,专门补偿VBE的高阶项

这种架构的优势在于既保留了传统带隙基准的简单可靠,又通过数字辅助的模拟技术实现了高阶补偿。实测显示,采用三阶补偿后,温度漂移从原先的15ppm/°C降至1.9ppm/°C。

3.2 关键电路模块实现细节

温度传感器模块采用5个BJT串联结构,每个管子的VBE差异形成约60mV的温度敏感电压。通过精密电阻分压网络产生4个阈值电压,将-40°C至125°C范围划分为5个区间。特别需要注意的是,这里的BJT必须采用相同的版图布局以确保匹配性。

可调比例网络的设计颇具技巧:我们采用R-2R结构而非简单的开关电阻阵列,主要考虑两个因素:一是R-2R网络的等效电阻温度系数一致性更好;二是其开关引起的瞬态扰动较小。实际布局时,将MSB开关放在靠近输出端的位置,有效降低了开关电荷注入的影响。

非线性校正模块的核心是一个由温度控制的跨导放大器。其偏置电流与绝对温度成正比(PTAT),通过精心设计的转移函数,产生与VBE高阶项相反的校正电压。这个模块消耗了约30%的总电流预算,但贡献了超过60%的温漂改善效果。

4. 电路实现与性能优化

4.1 Cadence设计流程实践

在Cadence设计环境中,我们建立了完整的设计-仿真-验证流程。原理图设计阶段有几个关键点值得注意:

  1. 器件模型选择:必须启用Foundry提供的全温度范围模型(通常是HSPICE格式的TT/FF/SS模型),普通BSIM模型无法准确预测低温特性

  2. 蒙特卡洛分析设置:除了常规的工艺角分析,还需要设置全局和局部失配参数,特别是电阻的梯度变化模型

  3. 噪声分析技巧:在noise仿真时,要将积分频率范围分为三段(10Hz-1kHz,1kHz-1MHz,1MHz-1GHz)分别分析,再合成总噪声

版图设计阶段,我们采用了以下特殊处理:

  • 所有匹配器件采用共质心布局,并添加dummy器件
  • 敏感模拟走线采用双层屏蔽:内层guard ring,外层N-well隔离
  • 电源线采用星型拓扑,基准核心单独供电

4.2 性能优化实战经验

低温漂优化:通过参数扫描发现,当K值在22-24范围内变化时,温漂呈现明显的抛物线特性。我们采用如下优化步骤:

  1. 固定其他参数,扫描K值找到粗略最优区间
  2. 在该区间内进行0.1步长的精细扫描
  3. 加入工艺偏差进行蒙特卡洛验证
  4. 最终确定K=23.15时三西格玛良率最高

PSRR提升技巧:要达到-90dB的电源抑制比,我们采用了三级防护措施:

  1. 核心电路采用cascode电流镜结构
  2. 电源输入端插入RC滤波网络(R=10kΩ,C=20pF)
  3. 运放采用高增益架构(开环增益>100dB)

低功耗实现:在147μA的总电流预算下,我们通过以下方法优化:

  • 采用亚阈值偏置技术设计运放输入对管
  • 动态偏置技术:根据温度区间调整偏置电流
  • 时钟门控技术:仅在进行区间切换时激活数字控制电路

5. 测试验证与问题排查

5.1 关键测试结果分析

经过完整的PVT验证,我们获得了如下实测数据:

  • 温度特性:在-40°C至125°C范围内,最大偏差0.43mV(等效1.7ppm/°C)
  • 电源抑制比:100kHz时达到-92dB(优于设计指标)
  • 启动时间:在1.8V电源下为280μs(受限于低功耗设计)
  • 长期稳定性:1000小时老化测试后漂移小于0.05%

特别值得注意的是噪声测试结果:在10Hz至1GHz积分范围内测得44μVrms,其中低频1/f噪声贡献了约70%。通过分析发现,这主要来自运放输入对管的界面态噪声。后续通过优化退火工艺,成功将噪声降至38μVrms。

5.2 典型问题与解决方案

问题1:高温区间切换时的电压跳变
现象:温度升至85°C左右时出现约0.5mV的阶跃变化
排查过程:

  1. 检查区间切换逻辑信号,确认无毛刺
  2. 分析发现是R-2R网络开关的电荷注入导致
    解决方案:
  • 在开关控制端增加缓冲延迟电路
  • 调整开关尺寸,减小栅极电容
  • 最终将跳变控制在0.1mV以内

问题2:电源电压瞬变时的基准波动
现象:电源出现1V/μs的快速变化时,输出有约2mV的波动
根本原因:运放的摆率限制导致反馈环路暂时失效
优化措施:

  • 在误差放大器增加slew rate增强电路
  • 采用局部正反馈技术提升瞬态响应
  • 改进后波动幅度降至0.3mV

问题3:量产测试中的良率波动
现象:初期良率仅65%,主要失效模式为温漂超标
根本原因:电阻匹配度不足导致K值偏差
解决方案:

  • 将关键电阻从多晶硅改为高精度金属电阻
  • 增加修调熔丝网络(4-bit精度)
  • 良率提升至92%以上

6. 设计文档与工程实践建议

完整的37页设计文档包含以下核心内容:

  1. 数学推导部分:详细展示了从玻尔兹曼方程出发,推导高阶补偿项的全过程
  2. 仿真方法指南:包括如何设置温度扫描步长、噪声分析带宽选择等实用技巧
  3. 版图设计规范:特别强调了匹配器件的布局规则和抗干扰措施

对于希望复现或改进此设计的工程师,我有几点实用建议:

  • 在初期仿真时,先使用理想器件验证架构可行性,再逐步引入实际模型
  • 温度补偿参数的优化建议采用脚本自动化,手动调整效率太低
  • 测试阶段务必使用低热阻封装,避免测试夹具引入温度梯度
  • 对于噪声敏感应用,可在输出端增加一个低通滤波器(截止频率约1kHz)

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